ČVUT DSpace
  • Search DSpace
  • Čeština
  • Login
  • Čeština
  • Čeština
View Item 
  •   ČVUT DSpace
  • Czech Technical University in Prague
  • Faculty of Electrical Engineering
  • Department of Microelectronics
  • Master Theses - 13134
  • View Item
  • Czech Technical University in Prague
  • Faculty of Electrical Engineering
  • Department of Microelectronics
  • Master Theses - 13134
  • View Item
JavaScript is disabled for your browser. Some features of this site may not work without it.

Implementace verifikační komponenty - modelu NFC přijímače

Verification Component Implementation - Model of NFC

Type of document
diplomová práce
master thesis
Author
Ján Jendrušák
Supervisor
Jakovenko Jiří
Opponent
Šťastný Jakub
Field of study
Elektronika
Study program
Elektronika a komunikace
Institutions assigning rank
katedra mikroelektroniky



Rights
A university thesis is a work protected by the Copyright Act. Extracts, copies and transcripts of the thesis are allowed for personal use only and at one?s own expense. The use of thesis should be in compliance with the Copyright Act http://www.mkcr.cz/assets/autorske-pravo/01-3982006.pdf and the citation ethics http://knihovny.cvut.cz/vychova/vskp.html
Vysokoškolská závěrečná práce je dílo chráněné autorským zákonem. Je možné pořizovat z něj na své náklady a pro svoji osobní potřebu výpisy, opisy a rozmnoženiny. Jeho využití musí být v souladu s autorským zákonem http://www.mkcr.cz/assets/autorske-pravo/01-3982006.pdf a citační etikou http://knihovny.cvut.cz/vychova/vskp.html
Metadata
Show full item record
Abstract
Návrh digitálnych obvodov je komplexný proces, ktorý zahŕňa verifikáciu chovania návrhu predtým, ako je na záver implementovaný. Universal Verification Methodology (UVM) je prísľubom efektívneho spôsobu verifikovania digitálnych návrhov s ktoroukoľvek simulačnou platformou. Použitie UVM je demonštrované v tejto diplomovej práci návrhom verifikačného komponentu pre NFC Type 2 Tag Platform, špecifikácie pre bezdrôtové tagy vo vysokom frekvenčnom pásme. Kompletne funkčný verifikačný komponent spolu s predpripraveným verifikačným plánom by malo zaručiť, že digitálny návrh splňuje požiadavky protokolu na logickej úrovni.
 
To design digital circuits is a complex process, which involves verification of design behaviour before it is actually implemented. Universal Verification Methodology (UVM) promises an efficient way of verifying digital designs with any major simulation platform. Using UVM is demonstrated in this paper to build a verification component for NFC Type 2 Tag Platform, the operational specification for wireless tags in high frequency band. Completely functioning UVC together with prepared verification plan ensures that the Device Under Test (DUT) complies with NFC Type 2 Tag Platform on logical level.
 
URI
http://hdl.handle.net/10467/83082
View/Open
PLNY_TEXT (4.983Mb)
POSUDEK (194.9Kb)
POSUDEK (430.9Kb)
Collections
  • Diplomové práce - 13134 [285]

České vysoké učení technické v Praze copyright © 2016 

DSpace software copyright © 2002-2016  Duraspace

Contact Us | Send Feedback
Theme by 
@mire NV
 

 

Useful links

CTU in PragueCentral library of CTUAbout CTU Digital LibraryResourcesStudy and library skillsResearch support

Browse

All of DSpaceCommunities & CollectionsBy Issue DateAuthorsTitlesSubjectsThis CollectionBy Issue DateAuthorsTitlesSubjects

My Account

Login

České vysoké učení technické v Praze copyright © 2016 

DSpace software copyright © 2002-2016  Duraspace

Contact Us | Send Feedback
Theme by 
@mire NV